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  1. 紀要論文
  2. 琉球大学農家政工学部学術報告
  3. 11号
  1. 部局別インデックス
  2. 工学部

特殊デイジタル計算機“遅延線路数ふるい”の論理および回路設計(摘要)

http://hdl.handle.net/20.500.12000/19458
http://hdl.handle.net/20.500.12000/19458
86e9110a-3bd4-4a41-b411-271480c83435
名前 / ファイル ライセンス アクション
No11p168.pdf No11p168.pdf
Item type デフォルトアイテムタイプ(フル)(1)
公開日 2011-04-28
タイトル
タイトル 特殊デイジタル計算機“遅延線路数ふるい”の論理および回路設計(摘要)
言語 ja
作成者 Kyan, Seiki

× Kyan, Seiki

en Kyan, Seiki

喜屋武, 盛基

× 喜屋武, 盛基

ja 喜屋武, 盛基

アクセス権
アクセス権 open access
アクセス権URI http://purl.org/coar/access_right/c_abf2
内容記述
内容記述タイプ Other
内容記述 いわゆる万能デイジタル計算機(general purpose digital computer)は文字通り万能でありあらゆる種類の演算から言語の翻訳などに至るまで適当なプログラミングにより行なうことができる。しかしこの型の計算機はある種の計算にはまったく不向きで,その驚くべき早さの演算能力をもってしても相当長い時間を必要とすることが知られている。整数論の二次不定方程式やその他の平方剰余の問題を解くのに使はれる連立合同式の解法がその一つである。この種の計算を万能計算機に行なわせるには経済的に不可能なことなので,この計算だけを行なわせる特殊目的のデジタル計算機の開発が数年前から試みられている。この論文では“数ふるい”と称する連立合同式を解くことのみを目的とする電子計算機の論理設計と回路試作について論じている。この計算機の記憶装置(メモリ)としてはLC遅延線路を主体として20.5μsの長さの遅延線路に21ビットのパルスをたくわえまた1ビットの記憶にはフリップフロップを用いて行なった。演算をコントロールする主要部分である計数回路には遅延線路を用いた特殊な設計のビート計数回路を用いて信頼度を高めることができた。このため高価な電子管式計数器の使用をはぶくことができた。試作機の全記憶容量は240ビットである。この容量の範囲で可能な種々の連立合同式の計算を行なわせて正しい結果を得ることができた。最後に誤動作自動検出装置について論じ,その論理設計も行なった。
内容記述タイプ Other
内容記述 紀要論文
出版者
言語 ja
出版者 琉球大学農家政工学部
言語
言語 eng
資源タイプ
資源タイプ departmental bulletin paper
資源タイプ識別子 http://purl.org/coar/resource_type/c_6501
出版タイプ
出版タイプ VoR
出版タイプResource http://purl.org/coar/version/c_970fb48d4fbd8a85
識別子
識別子 http://hdl.handle.net/20.500.12000/19458
識別子タイプ HDL
収録物識別子
収録物識別子タイプ ISSN
収録物識別子 0485-7828
収録物識別子タイプ NCID
収録物識別子 AN00250570
収録物名
言語 ja
収録物名 琉球大学農家政工学部学術報告
書誌情報
号 11, p. 168-198
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