WEKO3
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相対遅延モデルに基づく非同期式パイプラインシステムの論理設計と試作および評価
http://hdl.handle.net/20.500.12000/13508
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名前 / ファイル | ライセンス | アクション |
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17560361seika.pdf
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Item type | デフォルトアイテムタイプ(フル)(1) | |||||||||
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公開日 | 2009-12-01 | |||||||||
タイトル | ||||||||||
タイトル | 相対遅延モデルに基づく非同期式パイプラインシステムの論理設計と試作および評価 | |||||||||
言語 | ja | |||||||||
タイトル | ||||||||||
タイトル | Design, Manufacture and Evaluation of an Asynchronous Pipeline-System based on Relatively-Delay Model. | |||||||||
言語 | en | |||||||||
作成者 |
長田, 康敬
× 長田, 康敬
× Nagata, Yasunori
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アクセス権 | ||||||||||
アクセス権 | open access | |||||||||
アクセス権URI | http://purl.org/coar/access_right/c_abf2 | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | 非同期システム | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | パイプライン | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | 相対遅延 | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | 3値論理 | |||||||||
主題 | ||||||||||
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主題Scheme | Other | |||||||||
主題 | 時相論理 | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | システム検証 | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | ヒステリシスゲート | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | 非同期回路 | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | 計算機システム | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | 様相論理 | |||||||||
主題 | ||||||||||
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主題 | ||||||||||
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主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | システムオンチップ | |||||||||
主題 | ||||||||||
言語 | ja | |||||||||
主題Scheme | Other | |||||||||
主題 | 多値論理 | |||||||||
内容記述 | ||||||||||
内容記述タイプ | Other | |||||||||
内容記述 | 科研費番号: 17560361 | |||||||||
内容記述 | ||||||||||
内容記述タイプ | Other | |||||||||
内容記述 | 2005年度~2008年度科学研究費補助金(基盤研究(C)研究成果報告書 | |||||||||
内容記述 | ||||||||||
内容記述タイプ | Other | |||||||||
内容記述 | 研究概要:コンピュータの超高速化,高機能化にともなって集積回路が超微細化加工されるに従い,従来のクロックによる同期式システムの考えだけでは正しい動作が保障されないため,要求/応答制御信号を用いた非同期システムが注目されている.本研究では,相対遅延モデルを提案し,これに基づく非同期システムやパイプラインシステムを設計し,これらをFPGA上に実装し,評価を行うものである.研究の途中で,D-素子や2 線論理実装ライブラリ,また,非同期システムの検証手法,時相論理の新しい体系などを提案している. | |||||||||
内容記述 | ||||||||||
内容記述タイプ | Other | |||||||||
内容記述 | 研究報告書 | |||||||||
出版者 | ||||||||||
言語 | ja | |||||||||
出版者 | 長田康敬 | |||||||||
言語 | ||||||||||
言語 | jpn | |||||||||
資源タイプ | ||||||||||
資源タイプ | research report | |||||||||
資源タイプ識別子 | http://purl.org/coar/resource_type/c_18ws | |||||||||
出版タイプ | ||||||||||
出版タイプ | AM | |||||||||
出版タイプResource | http://purl.org/coar/version/c_ab4af688f83e57aa | |||||||||
識別子 | ||||||||||
識別子 | http://hdl.handle.net/20.500.12000/13508 | |||||||||
識別子タイプ | HDL | |||||||||
書誌情報 |
発行日 2009-06-01 |